解压以后，出现下面的一幅电路图，我猜这是厂家做好的偏置电路。
直接运行，如下报错。
这是怎么回事？后来我又发现了一幅电路图，step_5_package_model，也在zap解压后的prj中，我改成如下三个端口端口模型，
用FET curve tracer仿真。
结果
显然不可能是FET的IDS与VDS关系图啊，FET的电流应该小多了吧？这是怎么回事？楼下为CFS_0303-SB的zap模型（原来从官方网站下的，怀疑模型文件官方是否给全。）
CFS0303-SB的zap模型。
CFS0303.part1.rar (2930 K)
CFS0303.part2.rar (2930 K)
CFS0303.part3.rar (2302 K)
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