图如附件所示，频段是8-9GHZ，输入端和输出端因不在一条直线上，因此加了2段拐角转换，是不是这个原因导致差损过大呢？
不过我的拐角切角按照《微波集成电路》中说的，切角长度是线宽的56%设计的。请问有什么办法可以解决这个问题呢？不可能微带差损经过
拐角差损就这么大吧？该如何改进呢？
端口设计是WAVEPORT，即使改为LUMP PORT也不会改善，相信不是这个原因。
呵呵，我不是高人，给点自己的看法
首先说明一点，如果理论能够很精确地指导实践，那么也不存在调试一说了。所以，你的“不过。”这句话就阻碍了你的思考，如果从更深层次点的说，为什么拐角就会导致损耗呢？因为它引入了电抗效应，那么切角是干嘛用的呢，抵消这个效应咯，没有说切角有一个很固定的精确理论值，因此对于切角的大小，角度都需要进行调整； 对于最后一句话，是说的对的，因为waveport是自匹配的，而lump是要设定特性阻抗的，后者是存在端口失配的。
建议：先调试一个切角，再调试第二个；另外，不要太对理论自信，理论终归是相对理想的环境，拿到实际中来，影响因素多得去了，将理论作为一个参考吧
谢谢2楼的，只是差损这么大，是否只是拐角引起的呢？是否还有其它的因素我没考虑到才导致这样的结果呢？
你先仿一个拐角试试看，这个模型我仿过，可以调过来的。从匹配角度来说，如果用waveport差损不会太差，你可以仿直线看看就知道了
我试过，即使是一段直的微带线，插损和驻波都较差，困惑！
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